S08: Teilgebiet 01 Iteration B4 fuer DOCX umgesetzt. Heading 1/2/3 in destengsblue (build/build-reference-docx.py Funktion set_heading_colors mit explizitem color val=0B5394, themeColor accent1 entfernt). Heading-Bottom-Borders direkt am Stil verworfen, weil Word die Border bei hanging-Indent linksbuendig statt zentriert rendert und der right-Indent sowohl Text als auch Border begrenzt. 21 Markdown-HRs aus cv.md entfernt - Quelle der wahrgenommenen Doppellinien war Pandocs DOCX-Konvertierung von --- Zeilen zu VML-rect mit o:hr=t (Embossed-Look). Tabellen-Strich-Zeilen blieben unangetastet. Zwischenfall: NTFS-Mount-Stale-Read der cv.md (20043 statt 20201 Bytes) haette fast die Live-Datei truncated, sofortige Wiederherstellung aus git show HEAD und HR-Removal erneut mit git-Version als Input. H2-Trennlinien via Post-Processing eingefuehrt (build/post-process-docx.py um Logik erweitert): nach jedem H2 wird ein leerer Trenn-Absatz mit linksbuendiger Bottom-Border eingefuegt, schwarz (000000), 8,6 cm Linienlaenge (right-Indent 4196 dxa), 1,25 pt Dicke (sz=10). Sandbox-Verifikation 7 H2 zu 7 Trenner. Visuelle Bestaetigung durch Thomas. teilgebiete/01-lebenslauf.md um Iteration-B4-Block ergaenzt (B4.1 Farben, B4.2 Heading-Border-Sackgasse, B4.3 HR-Removal inkl. Zwischenfall, B4.4 H2-Trennlinien) und Naechste-Schritte-Liste auf C/D verkuerzt.
This commit is contained in:
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- LinkedIn: https://www.linkedin.com/in/thomas-langer-b9742a2
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- Büroadresse: Biberger Straße 91, 82008 Unterhaching
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## Zusammenfassung
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- TÜV-zertifizierter AI Consultant und promovierter Ingenieur mit über 30 Jahren Erfahrung in Entwicklung, Test und System Integration von Elektronik
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- Kommunikations- und Präsentationsstärke auf allen Ebenen, von Fachteams bis Geschäftsführung
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- Flexibler Arbeitsstil als Gruppenleiter (10 Mitarbeiter), Team-Mitglied und autonomer Experte
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## Projekte als freiberuflicher Consultant
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### Seit Juli 2011 — Inhaber von DesTEngS Dr.-Ing. Thomas Langer, nahe München:
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- Anwendung von KI bei Konzepten, System Engineering, Software Design, Automatisierungen, System Integration und Tests
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- KI-gestützte Dokumentationen und Illustrationen
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### Aug. 2024 – Feb. 2026 — Consultant bei ASMPT (Industrielle Bestückungsmaschinen), System Integration Abteilung R&D 38, München:
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- KI-Workshop
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- Ermittlung von System Integration Standard Use-Cases und Erstellung der zugehörigen Vector CANalyzer Konfigurationen zur Steigerung der Effizienz durch Vereinheitlichung der Testplatz-Umgebungen
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- Entwicklung eines Python-Tools mit PyShark zur Konvertierung spezieller Bestückungsmaschinen Trace-Daten für die Nutzung in Vector CANalyzer
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### Sep. 2025 – Feb. 2026 — Projekt „Kischdle", Geschäftskonzept von 2 potenziellen Gründern:
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- On-Premise KI-System mit Consumer-GPU und Retrieval Augmented Generation (RAG)
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- Erweiterung durch PyTorch-Umgebung für multimodale KI-Modelle (Bild und Text), Evaluierungen des Inference-Modells Qwen3-VL-8B und des Embedding-Modells tomoro-colqwen3-embed-4b
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- Evaluierung von Langflow für Workflow-Automatisierungen mit AI-Agents
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### Jan. – Feb. 2026 — Consultant bei Lumiz (Marketing-Dienstleister), Taufkirchen:
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- KI-gestützte Automatisierung der Einkäufe auf einer Druckerei-Website mit UI.Vision
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- Hochladen der Druckdaten aus der Lumiz-Cloud
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- Protokollierung der Vorgänge
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### Nov. 2020 – Mai 2024 — Consultant bei ASMPT (Industrielle Bestückungsmaschinen), System Integration Abteilung R&D 38, München:
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- Maßgebliche Mitwirkung bei Konzepterstellung und Einführung eines neuen Gigabit Ethernet Feldbus für performantere Steuerung von ASMPTs industriellen Bestückungsmaschinen
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- Entdeckung sporadischer Zeitabweichungen der Ethernet-Interface Hardware, Idee und Aufbau einer hochpräzisen Zeit-Referenz mit einem preiswerten GPS-Modul, Feststellung einer signifikanten Spec-Verletzung der Vector Hardware Zeitbasis
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- Evaluierung GL Communications PacketExpert Gigabit Ethernet Tester
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### Aug. 2018 – Juli 2020 — Consultant bei Magna Electronics Europe (Automobil-Zulieferer), München:
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- LIDAR Compute Module
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- xDiagnostics ermöglichte eine Design-Validierung in einem frühen Entwicklungsstadium
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- Elektromagnetische Feldsimulationen mit CST für den GMSL Pfad eines Kameramoduls zur Verifikation der Signalintegrität
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### Nov. 2014 – Juli 2018 — Consultant bei Infineon, Abteilung DES TCP PCB, Großraum München:
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- Signal Integrity und Power Integrity Simulationen von IC Packages und PCBs
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- EM Feldsimulationen zur Modell Extraktion von IC Packages und PCBs
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- Erstellung von Matlab, Python und IronPython Programmen
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### Apr. – Aug. 2015 — Consultant bei Kathrein.net.tech (Ubidyne-Nachfolger), Ulm:
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- Inbetriebnahme, Evaluierung und Optimierung von Transceiver Modulen
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- Automatisierung von HF-Tests mit Matlab und Ruby
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### Sep. 2011 – Juli 2014 — Consultant bei Alcatel-Lucent, Abteilung MS/E, Stuttgart:
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- Projekt Light Radio AAA: Aktives Antennen Array für 2.5 GHz LTE
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- Erstellung von Test Routinen mit Matlab und embedded Linux Programmierung des WiFi SoC, Aufbau einer Messumgebung für automatisierte Tests
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- Agile Design mit Scrum
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### Juli 2011 — Gründung von DesTEngS Dr.-Ing. Thomas Langer (Ingenieurbüro), nahe Ulm
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## Berufliche Stationen vor der Selbständigkeit
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### Juli 2006 – Juni 2011 — Head of RF Integration bei Ubidyne (Startup, ca. 60 Mitarbeiter, aktive Antennen für Mobilfunk-Basisstationen), Abteilung Engineering, Ulm:
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- Antennenhersteller Kathrein, Andrew und Huber & Suhner
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- _(Ab Okt. 2009: Principal Member of Technical Staff)_
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### Jan. 2003 – Juni 2006 — Entwicklungsingenieur bei Toshiba Electronics Europe, European LSI Development and Engineering Centre, Düsseldorf:
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- Mitarbeit in den Normierungsgremien OIF und MIPI
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- Detaillierte Analysen elektrischer IC-Gehäuse (bis zu 11 Gb/s, bis zu 1444 Balls)
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- _(Ab April 2004: Senior Engineer)_
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### Dez. 2000 – Dez. 2002 — Entwicklungsingenieur bei Multilink Technology (Startup mit bis zu 360 Mitarbeitern weltweit, ICs und Module für faseroptische Übertragungssysteme), Berlin:
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- Entzerrer-ICs für Backplane-Systeme bis 12,5 Gb/s:
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- Systemsimulationen zur Bestimmung der Anforderungen für elektrische Entzerrer-ICs
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- 3,1 Gb/s 8:32 CMOS Demultiplexer-IC: BGA Gehäuse-Entwurf, Teststrategie, Leiterplatten-Entwicklung
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### Nov. 1998 – Nov. 2000 — Entwicklungsingenieur bei Siemens, Bereich Information and Communication Networks, München:
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- Verantwortlich für ein 1,8 GHz RX Frontend Modul für GSM Mobilfunk-Basisstationen: Projektkoordination, Definition der Architektur, Systemsimulation, Schaltungsentwurf, Layout, Evaluierung von Labormustern und Prototypen, Fertigungseinführung
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- Qualifizierung und Fertigungseinführung eines 10 GHz VCOs
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- Layout und Aufbautechnik von 40 Gb/s High Speed Digital Modulen für Faseroptische Systeme
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### Okt. 1994 – Okt. 1998 — Wissenschaftlicher Mitarbeiter am Ferdinand-Braun-Institut für Höchstfrequenztechnik, Berlin:
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- Erzeugung elektrischer Transienten im Picosekundenbereich mit einer nichtlinearen Diodenleitung
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- Elektromagnetische Feldsimulationen koplanarer Leitungsstrukturen bis 1 THz
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- Entwicklung eines breitbandigen Low-Power Transimpedanzverstärker GaAs-MMICs für 100 MHz - 6 GHz
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### Sep. 1992 – Aug. 1993 — Studentische Hilfskraft am Ferdinand-Braun-Institut für Höchstfrequenztechnik, Berlin:
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- Modellierung passiver Elemente, Dioden und Transistoren auf GaAs Wafern
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### Jan. 1990 – März 1992 — Studentische Hilfskraft am Hahn-Meitner-Institut, Berlin:
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- Entwurf und Aufbau von ultra-breitbandigen Verstärkern 10 KHz – 16 GHz inklusive Entwicklung und Implementierung eines neuen Verfahrens zur Temperaturkompensation
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## Ausbildung
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@@ -242,8 +204,6 @@ Okt. 1994 **Dipl.-Ing. Elektrotechnik** an der TU Berlin, Vertiefungsfach Hoch
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Juni 1986 **Abitur** am Oberstufenzentrum Elektrotechnik in Berlin
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## Trainings
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- Dez. 2016 — Ansys SIwave Training
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@@ -253,8 +213,6 @@ Juni 1986 **Abitur** am Oberstufenzentrum Elektrotechnik in Berlin
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- Apr. 2006 — Die Akademie, „Gedächtnis- und Konzentrationstraining"
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- Mai 2000 — Seminar „Persönlichkeitsentwicklung im Team"
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## Kenntnisse
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**KI:**
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Reference in New Issue
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